sd和rd连接到基本rs触发器的输入端。它们分别被预设和重置。低水平是有效的。当s d=1和rd=0时（sd的non为0，rd的non为1，即分别在两个控制端口从外部输入的电平值，因为低电平有效），无论输入d的状态如何，q=0，q non=1，即触发器设置为0。
当sd＝0和rd＝1时（sd不是1，rd不是0），q＝1，q不是0，触发器设置为1，sd和rd也被称为直接设置为1和设置为0。假设它们已被添加了高电平，这不会影响电路的工作。
扩展资料：
jk触发器的结构类似于rs触发器。区别在于r s触发器不允许r和s同时为1，而j k触发器允许j和k同时为1。当j和k同时变为1时，输出值状态将反转。也就是说，如果是0，就变成1；如果是1，就变成0。
d触发器（数据触发器或延迟触发器）由四个nand门组成，其中g1和g2构成基本的rs触发器。当电平触发主从触发器工作时，输入信号必须在正边之前加上。如果在高cp电平时输入端有干扰信号，则有可能使触发错误状态。
边缘触发器允许在cp触发器边缘到达之前添加输入信号。这样，大大缩短了输入干扰的时间，降低了干扰的可能性。边d触发器也称为保持块边d触发器。边缘d触发器可以由两个d触发器串联而成，但第一个d触发器的cp需要使用非门反向。
参考资料来源：
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